5级流水线的缺点和3级流水线的缺点相比有哪些优点

片上系统(SoC)需要在单个硅片上实现模/数混合集成与数字系统工艺兼容、功耗、面积等指标优化的高性能模/数转换器(Analog to Digital Converters,ADC)是片上系统中非常重要的单元它实现了模拟电蕗与数字电路之间的联系。流水线的缺点结构模/数转换器(Pipelined ADC)是一种研究和应用非常广泛的模/数转换器其结构本身并非属于基本模/数轉换器结构,但在精度、速度及功耗方面相对于其他类型都有很大的改进是高速高精度领域的主要应用类型之一。本文介绍了流水线的缺点A/D转换器的基本原理并构造了一个三级流水线的缺点结构的9位100 MSPS A/D转换器(ADC),采用Zarlink 0.6μm互补双极工艺模型对电路进行了模拟验证

1 三级鋶水线的缺点A/D转换器电路设计

使用分级技术是解决高速高分辨率的一种方法。可以使用两级或多级高速、低分辨率子ADC组合起来形成一個高速高分辨率的流水线的缺点ADC。

1.1 三级流水线的缺点A/D转换器工作原理

在基本A/D转换结构中有些具备高速性能,有些具备高精度性能没有能够同时达到高速高精度的要求。流水线的缺点ADC的出现在一定程度上解决了这个难题流水线的缺点结构可以在采样速度和转换精喥之间取得较好的平衡。图1是三级流水线的缺点ADC的结构

图1 三级流水线的缺点ADC的结构

由图1可知,流水线的缺点结构模/数转换器主要是由采样保持器、子ADC、子DAC及减法电路组成输入模拟信号首先送入第一个采保电路(TH 1),TH1的输出信号输出给第一个的子ADC(ADC1)和第二个采保电路(TH2)ADC1将输入信号转换得到高3位数字信号,该高3位数据通过DAC(DA C1)还原成模拟量再将该模拟量和TH2的输出一同输入到减法电路,并将差值由放大器放大一定倍數便得到第一级模拟余量信号。此模拟余量将作为第二级转换电路的输入信号重复上述步骤,得到次3位转换数据依此类推。

设输入信号为VinVin通过3位ADC产生的数字量为Dm,3位DAC输一模拟量为Vout则Vin,Dm和Vout的关系由式(1)、(2)决定

由式(2)可知,3位DAC还原得到的Vout小于等于输入信号Vin其差值就是包含低位数据位信息的模拟余量。为了使下一单元的ADC得到满幅输入以降低对子ADC性能的要求,还需将此模拟余量乘以ADC量化单位的倒数即將此模拟余量放大23倍后再送给下一级子转换器。

1.2 采样保持电路的设计与分析

图2为全差分采样保持电路(T/H电路)的半边电路;图3为该T/H电路控制时钟信号

图3 T/H电路控制时钟信号

当PCLK和NCLK信号为低电平时,T/H电路工作在采样模式Q5,Q7导通Q6,Q8截止A节点电压升高,B节点电压降低這时Q1~Q4均导通且工作在正向放大区,它们形成一个AB类缓冲器驱动保持电容CH该输入电路结构具有输入偏置电流小、输入阻抗高、交调失真尛的特点。当PCLK和NCLK信号为高电平时T/H电路工作在保持模式,Q5Q7截止,Q6Q8导通,钳位电路(CLAMP)开始作用使A节点电压钳位在VCH-VthN,使B结点的电压钳位茬VCH+VthP(VthN和Vthp分别表示NPN管和PNP管的BE结导通屯压)也使A,B两节点呈现为低阻抗节点此时Q1~Q4均截止,故而形成输入信号与保持电容之间的二重隔离消除保持模式的信号馈通。

RC和CH构成一个低通滤波器其截止频率会随负载而变化。为克服这一缺点在输出端设计一个输出缓冲器。采样/保持电路的噪声特性主要来自于Q1~Q4的基极寄生电阻热噪声以及它们的散粒噪声和带宽限制电阻RC热噪声电路设计时,选用大尺寸的器件来減小基极电阻Rb使得基极寄生电阻热噪声最小化。将Q3Q4偏置在较大的静态电流来最小化它们的散粒噪声,同时采样模式动态特性也要求Q3Q4囿大的静态电流,以减小VBE调制的影响当该T/H电路被偏置在大电流时,它将有大的带宽因此必须串联电阻RC来限制带宽以滤除高频噪声。夶的偏置电流也要在功耗和性能之间进行折衷考虑

1.3 子ADC的设计与分析

折叠型结构有比较器数量少、芯片复杂程度低、功耗较小的特点,具有较好的发展前景将折叠结构ADC应用于流水线的缺点(Pipeline)技术中,构成流水线的缺点折叠式ADC则可以提高其工作速度。折叠结构ADC的比较器个數与其分辨率成线性比例关系1个n位分辨率的折叠结构ADC仅仅需要n个比较器。这不仅减小了芯片面积而且降低了功耗。折叠单元电路是折疊式ADC的核心模块其数学模型及波形模型如图4所示。

图4 折叠电路数学模型及波形模型

折叠单元电路工作原理如下;设折叠单元输入电压范圍为-VR~+VR如图4所示,输入信号同时送给跟随单元和比较器跟随单元实现的功能是使得其输出端A,B分别跟随Vin+Vin-中较高者和较低者;平移单え将跟随单元的输出电压进行平移,使其达到信号折叠的目的如图4所示。其输出的电压信号Vout+Vout-作为下一级折叠单元的输入信号。比较器輸出的是格雷码数字输出由于ADC最终要实现二进制码输出,所以还需要在后续电路中实现格雷码向二进制码的转换

本文设计的A/D转换器電路采用2级折叠结构的子ADC,产生3位数字信号输出2组折叠单元具有相同的结构,折叠单元接收差分模拟输入信号产生1位输出数字信号,哃时产生1对差分折叠模拟输出信号输出给下一级折叠单元图5给出了折叠单元的结构原理,以及它的输入/输出波形

图5 折叠单元的结构原理以及它的输入/输出波形

模拟输入电压VINH,VINL驱动一对互补的射极跟随器(折叠单元)输出一对折叠信号VXH,VXLVXH,VXL分别跟随VINHVINL中电压较高的一個和较低的一个,这样就完成了输入信号的折叠信号的共模电平由平移单元调整,平移单元由平移电阻R1(R2)及跟随器Q1(Q2)组成,最终得到输出信号VOHVOL。VINHVINL还通过折叠单元放大后输入预放大比较器产生格雷码数字信号,并完成格雷码二进制码转换  A/D转换器的子ADC实现模拟信号量化為格雷码的同时,实现格雷码向二进制码的转换所以在转换过程中模拟信号必须在格雷码被锁存之前全部被折叠单元处理完毕。这里的折叠单元都是以射极跟随器为基础构成的所以整个折叠转化过程很快。由于折叠单元的增益为一模拟信号通过跟随器完成折叠之后振幅减半。

2 三级流水线的缺点A/D转换器电路仿真与分析

该转换器采用Zarlink 0.6 μm双多晶互补双极工艺实现NPN管,PNP管特性频率分别可以达到25 GHz和19 GHz完全滿足电路性能要求。并使用Cadence Spectre电路仿真软件对电路进行仿真验证

经Spectre仿真验证,T/H电路在-40~+100℃内均能正常工作图6是典型工艺条件下,输入信号频率为10 MHz、幅度为2 V时采样/保持电路的输出波形。图6中在保持阶段保持电压的变化很小,其变化量不大于70μV故该电路完全满足9位嘚精度要求。

图7是采样频率为100 MHz输入信号在幅度为2.2 V、频率为25 MHz情况下,对输出信号做离散傅里叶变换(DFT)得到的频谱图由图可知,输入信号頻率为25 MHz时无杂散动态范围(SFDR)为97.84 dB完全满足设计要求。

图7 采样/保持电路的SFDR

图8是9位100 MSPS三级流水线的缺点A/D转换器整体电路图采样时钟CP频率为100 MHz,輸入信号为一个上升的斜波的正弦波峰峰值为2.2 V。图9和图10分别为A/D转换器的瞬态仿真结果和动态仿真结果

由仿真结果可以看出,电路具有良好的线性度在整个输入范围内鲜见误码。典型的DNL为0.7LSBINL为2.0LSB,满足电路设计要求

本文设计了一个9位100 MHz低功耗流水线的缺点A/D转换器电蕗。该A/D转换器采用开环结构的采样保持电路提高了输入带宽使用折叠结构子ADC,简化了电路结构减小了芯片面积和功耗。该ADC有效输入帶宽达到100 MHz在奈奎斯特频率范围内,整个ADC的有效位数始终高于10位在100 MHz采样频率下,电路的功耗仅为650 mW

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随着我国工业快速的发展很多企业都在使用流水线的缺点设备,在企业的批量生产中不可或缺流水线的缺点设备布置设计要按照装配工艺流程统一协调,保证物流设計的合理性即整个产品装配过程是连续的,中间没有停顿、倒流和长距离运输那么流水线的缺点运行速度如何设计和调节?运行速度昰流水线的缺点生产设备设计中的一个重要环节它牵涉到生产线在使用中的运行效率,以及如何保持整条生产线的生产节奏对运行速喥的控制,在一定程度上影响着企业的生产效率那么,流水线的缺点运行速度在一个什么样的范围内才是较为合理的呢?流水线的缺点的運行速度可以简单理解为生产线将产品从A工位运送到B工位的时间但在这段时间内,B工位的工作人员需要完成手中产品的相关加工并且通过生产线运送至下一工位继续操作。如果流水线的缺点设备运行速度过快会导致产品在B工位的积压,以及影响该工位的加工质量若設备运行速度过慢,会导致生产的连续性受到影响从而使得整条生产线的效率下降。所以设备运行速度的快慢对于产品的生产加工非瑺重要。流水线的缺点设备在方案的设计过程中运行速度一般是已经设定好的。但速度并不固定而是在一定的可调节范围。其中输送类流水线的缺点常见的速度设定是1-5米/分钟可调,空间类输送线在0.5-5米/分钟可调运行速度的设计时依据客户提供的生产数据和要求设定的,同时也考虑到后期因生产熟练度的提高对流水线的缺点生产线的运行速度有提高的需要,速度的设定会在一个合理的范围内

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济南環形组装线什么牌子好

流水线的缺点是在一定的线路上连续输送货物搬运机械,又称输送线或者输送机一般包括牵引件、承载构件、驱動装置、张紧装置、改向装置和支承件等。不同的使用环境所要求的皮带材质、尺寸也不一样。一般而言皮带流水线的缺点只适用于承载重量较轻的产品;如果产品重量超过10KG,一般都需要采用滚筒输送带或者无动力滚筒流水线的缺点皮带原料的选择:一般有橡胶带、PVC帶、PE带、铁氟龙带、帆布带、食品带供选择。皮带的厚度:流水线的缺点的皮带一般根据生产需求而定常规的皮带厚度为8mm。为您介绍部件级流水线的缺点、处理机级流水线的缺点以及处理机间流水线的缺点的区别部件级流水线的缺点:把处理机中的部件进行分段,再把這些部件分段相互连接而成它使得运算操作能够按流水方式进行。这种流水线的缺点也称为运算操作流水线的缺点处理机级流水线的缺点:又称指令流水线的缺点。它是把指令的执行过程按照流水方式进行处理即把一条指令的执行过程***为若干个子过程,每个子过程在獨立的功能部件中执行处理机间流水线的缺点:又称为宏流水线的缺点。它是把多个处理机串行连接起来对同一数据流进行处理,每个处理机完成整个任务中的一部分前一个处理机的输出结果存入存储器中,作为后一个处理机的输入

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我国对滚筒流水线的缺点的运用是非常广泛的包含有电子电气行业、服装行业、医疗器械行业、物鋶运输和包装行业等。不同行业在设计流水线的缺点的时候会根据生产产品的特性,设计不同的滚筒直径和数量采用单排或双排链的運输方式。今天我们就深入了解下滚筒流水线的缺点在运用上有哪些优点值得企业如此欢迎。滚筒流水线的缺点大多是采用铝制材料制莋而成这些材料在日常的使用中不会出现生锈的问题。一旦出现污渍清洁起来是非常方便的。可以说它的洁净度和美观度在流水中是非常高的企业如果采用它辅助生产,很少会出现故障的问题即使有,也可以比较快地解决因为滚筒流水线的缺点的设计相对比较简單,故障问题也比较单一滚筒流水线的缺点可以跟各种各样的设备配合使用,减少生产衔接问题它在设计上非常灵活,可以在两端根據要求变化滚筒的长度和直径并且不会影响整体流水线的缺点的运转。例如:流水线的缺点生产厂家可以结合企业各种生产设备的出料ロ设计出尺寸适当的滚筒装置,可以平稳地承接设备自动化生产产品然后通过特制滚筒的转动运输到滚筒流水线的缺点的主体。滚筒鋶水线的缺点在制作成本上并算特别高无论是大型加工工厂还是小工厂,都能够在预算成本下制作出适合自己的滚筒设备在满足自身苼产的前提下,工厂企业是非常注重生产成本的滚筒流水线的缺点制成成本不高、维修运营成本也不高,自然受企业的欢迎

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跟着工业的不断的开展,车间在生产的过程中皮带流水線的缺点起到了很重要的作用。有许多的人不知道皮带流水线的缺点是如何做保养与维护的有些工厂在购买以后就从来不做任何维护,矗到流水线的缺点停此工作坏了影响生产时才想到该维护了。此时为时已晚了在维修时间生产停了工,工人停了工所带来的也是不尐的损失。下面小编就在这里跟大家介绍下皮带流水线的缺点是如何做保养的1.流水线的缺点一般的状况下应上直线性的,也即便是水平┅条线的切误将其推弯变形,避免形成皮带跑边.皮带跑边、擦边此类状况蕞好急时找转业人员来对其进行调整.有时状况比较严重的话,皮带会卷进大滚筒内如呈现此类状况,需要马上关闭电源和马达联系专业人员来维护.2.变频器在封闭时蕞好把它调制到零,避免开机時皮带上有物品而形成一些不必要的丢失.如流水线的缺点设备没有正返转功用,变频器蕞好是不要规划返转功能可张其功用鎖死,避免皮带回转形成跑边磨擦损坏3.减速机应不定时查看内部机油是否够,从外部一个圆形小窗口就能看到如少机油或机油不够,会形成内蔀齿轮磨擦曾大长时间作业在这样的一种状况下会把齿轮磨损坏导至无法运用,当设备运用半年或一年后蕞好替换一次机油4.皮带流水設备上的链条、头尾滚筒上的轴承以及面上的承载小滚筒,都得不定时的打点润滑油或机油都行以避免缺油时发出怪声,长时间缺油还會形成损坏5.变频器、电机不能进水,如长时间不运用时应保持地点的环境干燥避免形成短路烧坏。

装线是指专门用来组装各类产品的苼产线它广泛应用于玩具、机械、汽车、电子、电器等方面,在现实生活中我们所使用的很多产品都是通过它组装出来的我们都知道電脑、汽车等产品是由很多零部件组装而成,组装线生产厂家而这些零件也只有组装成成品才能够正常使用组装线是人和输送设备的分笁协作的蕞佳拍档,通过输送线系统的分配满足了多种产品的装配需求,组装线给企业生产带来的主要作用有:1、通过自动组装线每个步骤的加工装卸产品的质量上升,加工的精度高;2、生产设备利用率得到了提高由于按部就班的进行组装线生产,产量相对于分散单獨的作业产量翻了好几倍;3、自动组装线的生产效率稳定即使组装线的某个环节出现了故障,输送线传送系统能有效的绕过该故障环节進行连续的作业

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三级流水线的缺点RISC-V处理器设计与驗证

2020年电子技术应用第5期

折如义1李炳辉2,姜佩贺2

1.河套学院 理学院内蒙古 巴彦淖尔015000;2.烟台大学 光电信息科学技术学院,山东 烟台264005

RISC-V作为一種开源精简指令集架构自发布以来便得到了大量关注。设计了一种三级流水线的缺点的RISC-V处理器其中,采用静态预测BTFN技术处理流水线的缺点执行中的分支情况采用前向旁路传播技术解决数据冒险问题,同时采用资源共享的办法,复用寄存器堆、加法器、选择器等模块使设计面积得到一定的优化。在VCS和Verdi等EDA工具中使用RV32I整数运算指令集对处理器进行了仿真测试,结果表明所设计的处理器功能正确,达箌预定目标

    集成电路产业是国家战略性产业,是推动信息产业发展的源泉和动力而我国集成电路产业发展严重滞后[1]。在各行各业需求量与日俱增的领域ARM处理器在嵌入式领域占主导地,Intel x86架构处理器在桌面和服务器领域占据着垄断地位[2]是加州大学伯克利分校于2014年设计并發布的一款开源指令集架构[3],具有免费开放、短小精悍、性能优越三大特征可以被任何学术机构或商业组织自由使用,能够满足从微控淛器到超级计算机等各种应用的需求[4]RISC-V的出现可能改变由ARM和Intel x86主导处理器架构的竞争格局[5]

    是处理器设计最重要的环节之一严重影响着处悝器的运算速度和运算模块的张度。早期的经典流水线的缺点是五级流水[6]分别为取指、译码、执行、访存和写回,流水线的缺点的长短鈈仅仅影响吞吐率而且影响面积开销现代的高性能处理器相比最早期的处理器往往具有更深级别的流水线的缺点。流水线的缺点的级数樾多流水线的缺点被切得越细,每一级流水线的缺点内容纳的硬件逻辑越小进而吞吐率性能更佳,这是流水线的缺点深度加深的正面意义[7]但由于级数加深,会消耗更多的寄存器带来更多的面积开销,同时对于分支预测失败只能采取冲刷流水线的缺点的方法解决浪費了处理器性能。因此流水线的缺点的深度要根据不同的应用场景选择,本设计采用三级流水线的缺点结构以在兼顾处理器功能的前提下实现低功耗的设计目标。

    基于以上背景本研究在分析了RISC-V指令系统的基础上,使用Verilog语言分别设计了RISC-V处理器的取值单元、译码单元和执荇单元最终实现了一款基于RISC-V指令集的32位三级流水处理器,并使用RV32I整数运算指令集对处理器进行了仿真验证达到预定目标。

折如义1李炳辉2,姜佩贺2

(1.河套学院 理学院内蒙古 巴彦淖尔015000;2.烟台大学 光电信息科学技术学院,山东 烟台264005)

参考资料

 

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